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Ces registres à décalage 8 bits disposent d'entrées série à portes ET et d'une entrée d'effacement asynchrone (CLR). Les entrées série à portes (A et B) permettent un contrôle total des données entrantes ; un niveau bas sur l'une des entrées empêche l'entrée de nouvelles données et réinitialise la première bascule au niveau bas lors de l'impulsion d'horloge (CLK) suivante. Une entrée de niveau haut active l'autre entrée, qui détermine alors l'état de la première bascule. Les données aux entrées série peuvent être modifiées lorsque CLK est à l'état haut ou bas, à condition que le temps de configuration minimum requis soit respecté. La synchronisation se produit lors de la transition de niveau bas à niveau haut de CLK.